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更新于 2月10日
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FPGA工程師-無錫(J10207)

1.5-2.5萬·14薪
  • 無錫濱湖區(qū)
  • 3-5年
  • 碩士
  • 全職
  • 招3人

職位描述

Verilog HDLVHDL
崗位職責(zé):
1.根據(jù)需求制定原型驗證方案，負(fù)責(zé)RTL轉(zhuǎn)碼、ASIC代碼裁剪、功能仿真、代碼綜合實現(xiàn)、板級實現(xiàn)等工作，并完成相關(guān)文檔；
2.負(fù)責(zé)各種高速接口的實現(xiàn)，包括DDR3、DDR4、PCIE、RAPIDIO、GMAC、SATA等，熟練應(yīng)用FPGA高速接口(例如:GTH/GTY)完成上述協(xié)議的實現(xiàn);
3.熟練使用XILINX最新架構(gòu)的FPGA，例如XCUK060/XCUV440/XCVU3P/XCVU19P，熟練掌握時序約束、收斂，熟悉XILINX SSI類FPGA的應(yīng)用;
4.配合設(shè)計工程師完成芯片所有功能的原型驗證工作；
5.獨立處理和解決所承擔(dān)的任務(wù)，編寫相應(yīng)的設(shè)計文檔；編寫各種相關(guān)文檔和資料。
任職要求:
1.碩士及以上學(xué)歷，F(xiàn)PGA開發(fā)或FPGA原型驗證工作三年以上經(jīng)驗；
2.熟練掌握市面上FPGA開發(fā)調(diào)試工具，對工具有深度使用經(jīng)驗，掌握時序分析，時序約束等技能;
3.熟練使用FPGA仿真工具，F(xiàn)PGA廠商工具自帶仿真軟件或者第三方仿真軟件;
4.熟練使用板級調(diào)試工具，例如示波器、頻譜儀、TDR、誤碼儀等調(diào)試工具，有復(fù)雜硬件系統(tǒng)調(diào)試經(jīng)驗者優(yōu)先;
5.熟悉一種以上高速接口協(xié)議，有PCIE接口實現(xiàn)、調(diào)試經(jīng)驗優(yōu)先;
6.了解一定信號完整性知識，有10G以上SERDES調(diào)試或驗證經(jīng)驗者優(yōu)先；
7.具有良好的英語技術(shù)文檔閱讀能力；
8.有團(tuán)隊合作精神，良好的溝通能力，踏實沉穩(wěn)，接受加班和出差者優(yōu)先。

工作地點

無錫濱湖區(qū)中科芯集成電路有限公司

職位發(fā)布者

唐先生/招聘管理

昨日活躍
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公司Logo中科芯集成電路有限公司公司標(biāo)簽
中科芯集成電路有限公司位于蠡湖之濱、大運河畔，主要從事超大規(guī)模集成電路的研發(fā)和生產(chǎn)，現(xiàn)有職工4700余人，教授級高工和高級工程師300余人，工程技術(shù)人員占職工總?cè)藬?shù)70%以上，擁有國家博士后科研工作站。中科芯具備集成電路設(shè)計、制造、測試、封裝、可靠性、應(yīng)用支持等完整的產(chǎn)業(yè)鏈，曾研制了我國首塊超大規(guī)模集成電路，承擔(dān)過500多項國家重點科研任務(wù)，獲國家獎18項，省部級獎近200項，多項填補(bǔ)了國內(nèi)空白，提高了核心元器件的國產(chǎn)化率，為國家微電子事業(yè)各個階段的發(fā)展做出過突出貢獻(xiàn)。中科芯圍繞集成電路產(chǎn)業(yè)，實施“一二三四五”戰(zhàn)略轉(zhuǎn)型，打造“5+N”平臺，堅持人才驅(qū)動，科技創(chuàng)新，持續(xù)推進(jìn)現(xiàn)代企業(yè)制度建設(shè)，建設(shè)先進(jìn)的設(shè)計、制造、封裝、可靠性檢測與應(yīng)用支撐平臺，形成完整的產(chǎn)業(yè)服務(wù)體系，不斷提升核心競爭力，努力成為“國內(nèi)卓越、世界一流”的集成電路創(chuàng)新型產(chǎn)業(yè)集團(tuán)。
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