職位描述
VHDLVerilog電子/半導體/集成電路
崗位職責：
1.負責項目中FPGA方案設計；
2.負責FPGA代碼編寫.維護；
3.負責FPGA設計文檔撰寫.維護；
4.負責FPGA代碼的調(diào)試；
5.配合項目進行系統(tǒng)調(diào)試；
6.參與項目設計中邏輯設計部分的設計與資源評估。
7.參照公司技術文檔規(guī)范，完成項目相關技術文件的編制、審核；
8.對項目進度負責；
9.完成領導交代的其他任務。
崗位要求：
1.本科及以上學歷，電子、電路或相關專業(yè)；
2.2年以上工作經(jīng)驗，其中1年以上設備板級電路設計開發(fā)工作經(jīng)驗
3.熟悉FPGA研發(fā)流程；熟練掌握VHDL或Verilog HDL語言；
4.熟練運用Modelsim.ISE或Altera QuartusⅡ等EDA軟件，熟練運用各類辦公軟件和自動化辦公設備；
5.熟悉數(shù)字信號處理理論知識，并有相關工作經(jīng)驗優(yōu)先；
6.熟悉電路基礎，熟悉FPGA與DSP、Altera等芯片協(xié)同工作知識
7.熟練集成開發(fā)工具軟件，獨立完成邏輯設計及仿真驗證；
8.積極主動，具備較強的責任心、溝通能力和團隊協(xié)作精神。
補充說明
1.職位福利：全勤獎、周末雙休、五險一金、節(jié)日福利、績效獎金、員工旅游
1.負責項目中FPGA方案設計；
2.負責FPGA代碼編寫.維護；
3.負責FPGA設計文檔撰寫.維護；
4.負責FPGA代碼的調(diào)試；
5.配合項目進行系統(tǒng)調(diào)試；
6.參與項目設計中邏輯設計部分的設計與資源評估。
7.參照公司技術文檔規(guī)范，完成項目相關技術文件的編制、審核；
8.對項目進度負責；
9.完成領導交代的其他任務。
崗位要求：
1.本科及以上學歷，電子、電路或相關專業(yè)；
2.2年以上工作經(jīng)驗，其中1年以上設備板級電路設計開發(fā)工作經(jīng)驗
3.熟悉FPGA研發(fā)流程；熟練掌握VHDL或Verilog HDL語言；
4.熟練運用Modelsim.ISE或Altera QuartusⅡ等EDA軟件，熟練運用各類辦公軟件和自動化辦公設備；
5.熟悉數(shù)字信號處理理論知識，并有相關工作經(jīng)驗優(yōu)先；
6.熟悉電路基礎，熟悉FPGA與DSP、Altera等芯片協(xié)同工作知識
7.熟練集成開發(fā)工具軟件，獨立完成邏輯設計及仿真驗證；
8.積極主動，具備較強的責任心、溝通能力和團隊協(xié)作精神。
補充說明
1.職位福利：全勤獎、周末雙休、五險一金、節(jié)日福利、績效獎金、員工旅游
工作地點
成都市-郫都區(qū)-高新西區(qū)西區(qū)大道531號2棟2層
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