職位描述
Verilog HDLFPGSADDR3電子/半導(dǎo)體/集成電路
職位描述：
負(fù)責(zé)參與項(xiàng)目整體系統(tǒng)方案設(shè)計(jì)及分析、RTL編碼、仿真、驗(yàn)證、時(shí)序約束/分析、調(diào)試，參與系統(tǒng)調(diào)試工作并協(xié)助定位BUG，完成項(xiàng)目相關(guān)文檔撰寫(xiě)及維護(hù)，項(xiàng)目相關(guān)代碼和工程維護(hù)。
任職要求：
1、電子、通信、微電子等相關(guān)專(zhuān)業(yè)，本科及以上學(xué)歷
2、FPGA或IC設(shè)計(jì)工作5年以上經(jīng)歷
3、熟練掌握Verilog/VHDL語(yǔ)言
4、能熟練閱讀英文手冊(cè)，具有良好的代碼風(fēng)格及技術(shù)文檔編寫(xiě)能力
5、具有良好的團(tuán)隊(duì)合作精神，良好的道德觀，善于鉆研并有獨(dú)自解決問(wèn)題的能力
6、熟練使用示波器、邏輯分析儀等工具
7、熟練掌握各種高速接口應(yīng)用（PCIE、USB、DDR、以太網(wǎng)等）
加分項(xiàng)：
1、了解ASIC設(shè)計(jì)流程或有成功流片經(jīng)歷
2、有嵌入式系統(tǒng)開(kāi)發(fā)經(jīng)驗(yàn)，掌握C/C++或Python等編程語(yǔ)言
有視頻、圖像相關(guān)工作經(jīng)歷
負(fù)責(zé)參與項(xiàng)目整體系統(tǒng)方案設(shè)計(jì)及分析、RTL編碼、仿真、驗(yàn)證、時(shí)序約束/分析、調(diào)試，參與系統(tǒng)調(diào)試工作并協(xié)助定位BUG，完成項(xiàng)目相關(guān)文檔撰寫(xiě)及維護(hù)，項(xiàng)目相關(guān)代碼和工程維護(hù)。
任職要求：
1、電子、通信、微電子等相關(guān)專(zhuān)業(yè)，本科及以上學(xué)歷
2、FPGA或IC設(shè)計(jì)工作5年以上經(jīng)歷
3、熟練掌握Verilog/VHDL語(yǔ)言
4、能熟練閱讀英文手冊(cè)，具有良好的代碼風(fēng)格及技術(shù)文檔編寫(xiě)能力
5、具有良好的團(tuán)隊(duì)合作精神，良好的道德觀，善于鉆研并有獨(dú)自解決問(wèn)題的能力
6、熟練使用示波器、邏輯分析儀等工具
7、熟練掌握各種高速接口應(yīng)用（PCIE、USB、DDR、以太網(wǎng)等）
加分項(xiàng)：
1、了解ASIC設(shè)計(jì)流程或有成功流片經(jīng)歷
2、有嵌入式系統(tǒng)開(kāi)發(fā)經(jīng)驗(yàn)，掌握C/C++或Python等編程語(yǔ)言
有視頻、圖像相關(guān)工作經(jīng)歷
工作地點(diǎn)
成都市武侯區(qū)高新區(qū)世紀(jì)城路1129號(hào)天府軟件園A區(qū)8棟A8-101
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成都理想境界科技有限公司關(guān)于我們IDEALSEE人始終堅(jiān)守奮斗精神，創(chuàng)新進(jìn)化，懷揣極客精神，立志創(chuàng)造未來(lái)，我們是一只年輕的隊(duì)伍——平均年齡小于30歲！我們?cè)谧鲆患芸?、很偉大的事情——你是否想過(guò)，也許有一天，科幻電影中的空間成像系統(tǒng)可以出現(xiàn)在你的家里。我們從2012年成立IDEALSEE以來(lái)，一直聚焦于使光學(xué)顯示技術(shù)，空間無(wú)介質(zhì)成像成為現(xiàn)實(shí)。IDEALSEE（理想境界）自成立以秉承改變視界的使命，致力于下一代光場(chǎng)顯示技術(shù)研發(fā)，目前已申請(qǐng)專(zhuān)利600余件（非同族），其中在光纖掃描顯示方面近400件，位于中國(guó)第一，全球第二，我們崇尚個(gè)人與團(tuán)隊(duì)共同成長(zhǎng)——新加入的你，會(huì)與一群博士、碩士小哥哥小姐姐們一起工作、學(xué)習(xí)、成長(zhǎng)。如果你是一個(gè)Geek，并且希望自己能成就一件了不起的事情，那么我們期待你的加入，讓我們一起創(chuàng)造奇跡吧！
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