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1、根據(jù)系統(tǒng)設(shè)計架構(gòu)，基于AMD/Intel系列FPGA，主導設(shè)計FPGA工作子流程；
2、負責基于FPGA的ADC/DAC/Serdes/PCIE等控制器的開發(fā)和維護；
3、負責產(chǎn)品功能需求分析，配合硬件工程師進行器件選型及驗證，以及邏輯系統(tǒng)/模塊設(shè)計、代碼編寫、仿真、調(diào)試和驗證；
4、積極協(xié)同硬件工程師、軟件工程師進行單板、系統(tǒng)的聯(lián)調(diào)工作，深入分析并解決FPGA本身以及與軟硬件交互交互而產(chǎn)生的各類問題，確保系統(tǒng)整體功能的穩(wěn)定實現(xiàn)；
5，根據(jù)產(chǎn)品對信號處理的特殊需求，提出FPGA設(shè)計方案上的創(chuàng)新并不斷優(yōu)化，提升產(chǎn)品的性能指標。
負責編寫FPGA相關(guān)的設(shè)計、測試等文檔；
6、根據(jù)公司技術(shù)文檔規(guī)范編寫相應的技術(shù)文檔。

1、電子/通信/計算機等相關(guān)專業(yè)，本科畢業(yè)5年以上，研究生畢業(yè)3年以上；
2、精通Xilinx/Altera公司的主流大規(guī)模FPGA器件；
3、精通Verilog/VHDL硬件描述語言，精通時序約束、時序分析、時序優(yōu)化方法，熟練掌握C/C++等編程語言；
4、精通Vivado/Quartus/Modelsim/Debussy等EDA工具的使用，熟練使用各類片上資源，能夠熟練運用工具進行高效開發(fā)，快速定位并解決開發(fā)過程中出現(xiàn)的問題；
5、熟悉DDR/LVDS/PCIE/Serdes等高速接口標準及相關(guān)協(xié)議，具有高速ADC/DAC、DDR3/4等應用開發(fā)經(jīng)驗者優(yōu)先考慮；
6、具備良好的編程習慣及良好的文檔管理習慣；
7、具備較強的自學能力，團隊精神以及抗壓能力；
8，具有高速ASIC芯片驗證經(jīng)驗的優(yōu)先考慮