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更新于 6月24日

嵌入式架構(gòu)師

2.1-3.5萬
  • 西安碑林區(qū)
  • 10年以上
  • 本科
  • 全職
  • 招1人

職位描述

32位單片機(jī)C++ARMDSPFPGA電子/半導(dǎo)體/集成電路
崗位職責(zé):
1、負(fù)責(zé)嵌入式應(yīng)用軟件產(chǎn)品總體架構(gòu)設(shè)計(jì)或子系統(tǒng)的架構(gòu)設(shè)計(jì),針對(duì)產(chǎn)品需求分析設(shè)計(jì)出可靠、可行的解決方案,在方案中能有效分析風(fēng)險(xiǎn)、通過設(shè)計(jì)規(guī)避已知問題、有效控制解決項(xiàng)目中的突發(fā)問題;
2、負(fù)責(zé)嵌入式應(yīng)用軟件的需求析、需求評(píng)審。負(fù)責(zé)技術(shù)規(guī)范和管理制度的制定;
3、負(fù)責(zé)開發(fā)的測(cè)試方案和測(cè)試環(huán)境的制定和建立;
4、 負(fù)責(zé)指導(dǎo)本部門同事技術(shù)方案實(shí)現(xiàn),技術(shù)培訓(xùn)管理工作,協(xié)助項(xiàng)目組、本部門的計(jì)劃和任務(wù)的監(jiān)督管理;
5、負(fù)責(zé)項(xiàng)目關(guān)鍵問題、關(guān)鍵技術(shù)的攻堅(jiān)處理,負(fù)責(zé)項(xiàng)目組、本部門的知識(shí)庫(kù)維護(hù)。
任職要求:
1、熟練使?Verilog/Vhdl硬件描述語?進(jìn)?FPGA代碼開發(fā)及仿真,能獨(dú)?承擔(dān)邏輯架構(gòu)設(shè)計(jì)、開發(fā)和驗(yàn)證;
2、熟悉Xilinx/Altera等FPGA器件,熟練使?相關(guān)開發(fā)及調(diào)試?具,有國(guó)產(chǎn)FPGA開發(fā)經(jīng)驗(yàn)優(yōu)先,
3、熟悉ARM架構(gòu)及開發(fā)優(yōu)先;有算法基礎(chǔ),雷達(dá)信號(hào)處理、通信協(xié)議實(shí)現(xiàn)經(jīng)驗(yàn)優(yōu)先,熟悉AD、DA開發(fā)經(jīng)驗(yàn)優(yōu)先,有?速數(shù)據(jù)處理經(jīng)驗(yàn)優(yōu)先;
4、熟悉TIDSP平臺(tái)的通信算法工程實(shí)現(xiàn),包括與之相關(guān)的控制軟件設(shè)計(jì)及驅(qū)動(dòng)設(shè)計(jì);
5、熟悉嵌入式驅(qū)動(dòng)的實(shí)現(xiàn)框架、常用驅(qū)動(dòng)的實(shí)現(xiàn)原理;
6、精通軟件設(shè)計(jì)模式和常用軟件技術(shù)架構(gòu)實(shí)現(xiàn)方式。熟練使用軟件設(shè)計(jì)工具和產(chǎn)品設(shè)計(jì)開發(fā)工具;
7、具有良好的溝通協(xié)調(diào)能力,能勤奮刻苦,踏實(shí)工作,能正確面對(duì)并積極協(xié)同解決項(xiàng)目問題和難題,能承受較高的工作壓力;
10、完成領(lǐng)導(dǎo)布置的其他任務(wù)。

工作地點(diǎn)

碑林區(qū)西安創(chuàng)新設(shè)計(jì)中心大樓

職位發(fā)布者

張先生/招聘經(jīng)理

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