職位描述
Verilog HDLVHDLC語言電子/半導(dǎo)體/集成電路
崗位職責(zé)：
1. 在FPGA工程師指導(dǎo)下，完成基于FPGA中小型項目開發(fā)，包括但不限于基礎(chǔ)通信協(xié)議模塊、板間互聯(lián)通信、常用芯片的控制與采集、自研芯片的控制與采集等；
2. 參與部分FPGA程序模塊的接口驗證工作；
3. 參與測試電路模塊的設(shè)計和測試工作；
4. 根據(jù)項目需要由部門領(lǐng)導(dǎo)安排的其它工作；
5. 其它實習(xí)生感興趣+公司可能使用到的技術(shù)。
任職要求：
1. 本科及以上學(xué)歷，實習(xí)期不低于三個月；
2.熟練掌握Verilog或VHDL語言以及C語言；
3. 具有一定的電路設(shè)計基礎(chǔ)，能在指導(dǎo)下完成FPGA電路原理圖以及PCBlayout設(shè)計；
4. 熟練使用示波器、萬用表、信號發(fā)生器等測量儀器；
5. 善于溝通、積極主動、有一定學(xué)習(xí)激情及責(zé)任心；
6. 電子或工科相關(guān)專業(yè)優(yōu)先，使用過ISE或Vivado軟件優(yōu)先，有實際項目經(jīng)驗的同學(xué)優(yōu)先，有ZYNQ開發(fā)經(jīng)驗優(yōu)先，熟悉cadence電路設(shè)計軟件優(yōu)先。
1. 在FPGA工程師指導(dǎo)下，完成基于FPGA中小型項目開發(fā)，包括但不限于基礎(chǔ)通信協(xié)議模塊、板間互聯(lián)通信、常用芯片的控制與采集、自研芯片的控制與采集等；
2. 參與部分FPGA程序模塊的接口驗證工作；
3. 參與測試電路模塊的設(shè)計和測試工作；
4. 根據(jù)項目需要由部門領(lǐng)導(dǎo)安排的其它工作；
5. 其它實習(xí)生感興趣+公司可能使用到的技術(shù)。
任職要求：
1. 本科及以上學(xué)歷，實習(xí)期不低于三個月；
2.熟練掌握Verilog或VHDL語言以及C語言；
3. 具有一定的電路設(shè)計基礎(chǔ)，能在指導(dǎo)下完成FPGA電路原理圖以及PCBlayout設(shè)計；
4. 熟練使用示波器、萬用表、信號發(fā)生器等測量儀器；
5. 善于溝通、積極主動、有一定學(xué)習(xí)激情及責(zé)任心；
6. 電子或工科相關(guān)專業(yè)優(yōu)先，使用過ISE或Vivado軟件優(yōu)先，有實際項目經(jīng)驗的同學(xué)優(yōu)先，有ZYNQ開發(fā)經(jīng)驗優(yōu)先，熟悉cadence電路設(shè)計軟件優(yōu)先。
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工作地點
雙流區(qū)成都善思微科技有限公司電子科大科技園D9棟2樓
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職位發(fā)布者
蔣艷清/人力
昨日活躍立即溝通
成都善思微科技有限公司成都善思微科技有限公司于2019年9月19日成立，是一家致力于固態(tài)成像芯片及探測器模組相關(guān)產(chǎn)品研發(fā)、生產(chǎn)和銷售的高科技企業(yè)，主營業(yè)務(wù)包括CMOS平板探測器、CT探測器、光子計數(shù)探測器等X射線探測器，以及其它基于單晶硅技術(shù)的固態(tài)成像芯片及探測器等。善思微的前身是北京納米維景科技有限公司探測器事業(yè)部，核心成員具有豐富的芯片及探測器產(chǎn)品研發(fā)經(jīng)驗，團隊在納米維景參與了全球領(lǐng)先的第六代靜態(tài)CT探測器芯片及部件的研發(fā)，同時通過自主攻關(guān)成功研發(fā)了第一款國產(chǎn)CMOS平板探測器，在單晶硅X射線探測器方面積累了豐富的經(jīng)驗。目前善思微研發(fā)人員占比超過70%，包括兩名清華博士以及多名川大、電子科大的碩士，具有很強的研發(fā)實力。善思微已經(jīng)具備了完整的產(chǎn)品研發(fā)、生產(chǎn)及銷售能力。其中專為牙科CBCT應(yīng)用開發(fā)的Merak系列CMOS平板探測器和線陣探測器已經(jīng)通過了國內(nèi)主流廠家的試用和注冊。專為工業(yè)無損檢測應(yīng)用開發(fā)的Pheda系列CMOS平板探測器累計銷售達數(shù)百萬元。
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