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崗位職責(zé)
1.負(fù)責(zé)智能監(jiān)測(cè)硬件系統(tǒng)的設(shè)計(jì)、選型與開(kāi)發(fā)（包括傳感器、數(shù)據(jù)采集設(shè)備、通信模塊等）；
2.主導(dǎo)硬件電路設(shè)計(jì)、PCB制圖、嵌入式系統(tǒng)開(kāi)發(fā)及硬件調(diào)試；
3.優(yōu)化數(shù)據(jù)采集設(shè)備的功耗、抗干擾能力及環(huán)境適應(yīng)性（如高低溫、濕度、振動(dòng)場(chǎng)景）；
4.開(kāi)發(fā)硬件與云端/邊緣計(jì)算平臺(tái)的數(shù)據(jù)通信接口，保障數(shù)據(jù)傳輸穩(wěn)定性；
5.參與現(xiàn)場(chǎng)設(shè)備部署、系統(tǒng)聯(lián)調(diào)及故障排查，提供硬件技術(shù)解決方案；
6.編寫硬件設(shè)計(jì)文檔、測(cè)試報(bào)告及生產(chǎn)指導(dǎo)手冊(cè)。

任職要求
1. 學(xué)歷與專業(yè)
本科及以上學(xué)歷，電子工程、自動(dòng)化、儀器儀表、結(jié)構(gòu)工程（硬件方向）等相關(guān)專業(yè)；
本科學(xué)歷或具備智能監(jiān)測(cè)硬件開(kāi)發(fā)經(jīng)驗(yàn)者優(yōu)先。

2. 核心技能
硬件開(kāi)發(fā)能力：
熟練使用Altium Designer、Cadence等EDA工具進(jìn)行電路設(shè)計(jì)與PCB Layout；
熟悉嵌入式開(kāi)發(fā)（STM32/ARM、RK系列等），掌握C/C++嵌入式編程；
熟悉傳感器（如傾角儀、視覺(jué)傳感器、MEMS加速度計(jì)）接口設(shè)計(jì)與信號(hào)調(diào)理電路；
具備低功耗設(shè)計(jì)、EMC防護(hù)或工業(yè)級(jí)硬件開(kāi)發(fā)經(jīng)驗(yàn)者優(yōu)先。

工程監(jiān)測(cè)知識(shí)：
了解結(jié)構(gòu)/巖土工程監(jiān)測(cè)原理（如應(yīng)變、沉降、傾斜監(jiān)測(cè)）；
熟悉RS485、LoRa、NB-IoT、4G/5G等通信協(xié)議與模塊選型。

3. 優(yōu)先條件
有智能監(jiān)測(cè)設(shè)備（如無(wú)線數(shù)據(jù)采集儀、邊緣計(jì)算網(wǎng)關(guān)）量產(chǎn)經(jīng)驗(yàn)；
熟悉FPGA開(kāi)發(fā)、linux開(kāi)發(fā)或高速數(shù)據(jù)采集系統(tǒng)設(shè)計(jì)；
參與過(guò)橋梁、隧道、邊坡等工程監(jiān)測(cè)項(xiàng)目硬件開(kāi)發(fā)；
持有硬件工程師認(rèn)證（如電子設(shè)計(jì)工程師、嵌入式系統(tǒng)證書）。

4. 綜合素質(zhì)
具備扎實(shí)的電子工程基礎(chǔ)與動(dòng)手能力（焊接、調(diào)試、儀器使用）；
能獨(dú)立完成硬件全生命周期開(kāi)發(fā)（設(shè)計(jì)→測(cè)試→量產(chǎn)）；
適應(yīng)工程現(xiàn)場(chǎng)環(huán)境，接受短期出差。