職位描述
Verilog HDLFPGA信號處理通信/網絡設備
工作內容：
我們正在尋找一位有經驗的FPGA高級工程師，負責開發(fā)和驗證高性能的FPGA功能，支持并帶領公司內的FPGA研發(fā)團隊開發(fā)項目。
主要職責：
- 負責設計和開發(fā)FPGA功能，包括GTH等高速接口，高速以太網UDP協議等；
- 根據工程師需求，參與FPGA架構設計，并與其他工程師緊密合作；
- 使用FPGA工具鏈對FPGA設計進行驗證，并對設計進行調試和測試；
- 撰寫FPGA設計文檔，包括輸入輸出描述、時序分析和布局等；
- 參與FPGA項目的開發(fā)和測試工作，并確保項目按照計劃進行并達到預期目
標。
- 能夠帶領團隊成員和客戶進行有效的溝通和合作，并協調成員完成開發(fā)任務達成目標。
職位要求：
- 大學本科及以上學歷，電子、計算機、自動化等相關專業(yè)；
- 3年以上的FPGA工程師經驗，有獨立開發(fā)FPGA項目的能力；
- 熟悉ALTERA和XILINX架構，掌握FPGA VIVADO MODELSIM工具；
- 熟悉數字信號處理、通信協議、嵌入式系統等知識；
- 有以太網UDP純邏輯開發(fā)經驗或者通信行業(yè)經驗優(yōu)先錄?。?br>- 具備良好的項目管理和溝通能力，能夠與團隊成員和客戶進行有效的溝通；
- 良好的團隊合作精神，能夠與團隊成員和客戶進行有效的溝通和合作。
我們正在尋找一位有經驗的FPGA高級工程師，負責開發(fā)和驗證高性能的FPGA功能，支持并帶領公司內的FPGA研發(fā)團隊開發(fā)項目。
主要職責：
- 負責設計和開發(fā)FPGA功能，包括GTH等高速接口，高速以太網UDP協議等；
- 根據工程師需求，參與FPGA架構設計，并與其他工程師緊密合作；
- 使用FPGA工具鏈對FPGA設計進行驗證，并對設計進行調試和測試；
- 撰寫FPGA設計文檔，包括輸入輸出描述、時序分析和布局等；
- 參與FPGA項目的開發(fā)和測試工作，并確保項目按照計劃進行并達到預期目
標。
- 能夠帶領團隊成員和客戶進行有效的溝通和合作，并協調成員完成開發(fā)任務達成目標。
職位要求：
- 大學本科及以上學歷，電子、計算機、自動化等相關專業(yè)；
- 3年以上的FPGA工程師經驗，有獨立開發(fā)FPGA項目的能力；
- 熟悉ALTERA和XILINX架構，掌握FPGA VIVADO MODELSIM工具；
- 熟悉數字信號處理、通信協議、嵌入式系統等知識；
- 有以太網UDP純邏輯開發(fā)經驗或者通信行業(yè)經驗優(yōu)先錄?。?br>- 具備良好的項目管理和溝通能力，能夠與團隊成員和客戶進行有效的溝通；
- 良好的團隊合作精神，能夠與團隊成員和客戶進行有效的溝通和合作。
工作地點
西安雁塔區(qū)瞪羚谷B座二樓201室
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池振恒/人事經理
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西安智芯通達科技有限公司西安智芯通達科技有限公司成立于2021年9月，是西北工業(yè)大學科技園有限公司重點孵化的科技轉化企業(yè)。在國家十四五規(guī)劃關于進一步推進產教融合政策背景下，依托***重點建設院校西北工業(yè)大學，致力為客戶在雷達、導航、通信等系統抗干擾領域提供系統級解決方案。公司積極響應國家號召，以“創(chuàng)新驅動，服務國防”的理念，在雷達、導航、通信等系統抗干擾領域解決多種關鍵技術，填補了國內行業(yè)空白。公司主持了多項省、部及***重點科研項目的研究，并取得了重大突破。公司自成立以來，受到了西工大科技園、高新區(qū)科創(chuàng)局、瞪羚谷創(chuàng)業(yè)園等相關單位的大力支持，在科技創(chuàng)新領域成長迅速。在抗干擾領域與國內眾多科研院所建立了合作，成功交付了的多個科研項目。2022年獲得了第十一屆全國創(chuàng)新創(chuàng)業(yè)大賽陜西賽區(qū)第二名、全國賽優(yōu)秀企業(yè)。公司秉承科研導向、以人為本的發(fā)展理念，擁有一支以博士、碩士為主的核心技術團隊。公司現處在快速發(fā)展階段，誠邀優(yōu)秀人才加盟！公司將為企業(yè)人才提供良好的發(fā)展平臺和個人成長空間。企業(yè)愿景公司：以科技興國為己任，以技術創(chuàng)新填補國內空白，攻克國內行業(yè)瓶頸為始終任務。產品：致力于在國防工業(yè)、軍民融合領域為行業(yè)用戶提供優(yōu)質的全套解決方案和產品服務。人才：鏈接校企，與高等學府共同培養(yǎng)創(chuàng)新型、復合型、應用型人才。
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