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崗位內(nèi)容： 1. 維護現(xiàn)有項目的代碼，擴展一些功能。 2. 編寫Verilog HDL代碼進行仿真、綜合和布局布線。 3. 測試代碼的功能和穩(wěn)定性 4. 相關板卡的測試。 任職要求： 1. 具有數(shù)字電路設計和FPGA開發(fā)經(jīng)驗。 2. 熟練掌握HDL編程語言（如Verilog、VHDL）。 3. 熟悉數(shù)字信號處理和可編程邏輯器件。 4. 熟練使用EDA工具，例如Quartus、Vivado等。 5. 具備良好的溝通與團隊協(xié)作能力以及問題解決能力。