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崗位職責(zé)：
主導(dǎo)智能計(jì)算平臺的下一代硬件架構(gòu)設(shè)計(jì)，推動處理器/加速器選型、高能效比互聯(lián)方案等前沿技術(shù)落地
針對AIoT/邊緣計(jì)算等創(chuàng)新場景，設(shè)計(jì)支持多模態(tài)計(jì)算的異構(gòu)硬件平臺架構(gòu)
探索Chiplet/3D集成等新型系統(tǒng)集成技術(shù)，持續(xù)提升平臺算力密度與能效比
與算法團(tuán)隊(duì)深度協(xié)同，主導(dǎo)硬件-算法協(xié)同設(shè)計(jì)（HW/SW Co-design）等創(chuàng)新實(shí)踐
構(gòu)建基于數(shù)字孿生的系統(tǒng)級仿真驗(yàn)證體系，推動敏捷開發(fā)流程落地
參與技術(shù)預(yù)研與原型開發(fā)，輸出高價值專利與技術(shù)白皮書
主導(dǎo)技術(shù)方案攻關(guān)，培養(yǎng)跨領(lǐng)域技術(shù)團(tuán)隊(duì)
任職要求：
90后優(yōu)先，碩士及以上學(xué)歷，電子/計(jì)算機(jī)/人工智能等前沿領(lǐng)域?qū)I(yè)背景
3年+智能硬件開發(fā)經(jīng)驗(yàn)，有成功量產(chǎn)的異構(gòu)計(jì)算平臺架構(gòu)經(jīng)驗(yàn)者優(yōu)先
精通ARM/RISC-V/異構(gòu)加速器等新銳架構(gòu)，對存算一體等創(chuàng)新技術(shù)有實(shí)踐者加分
深度掌握PCIe Gen5/CXL/UCIe等新一代互聯(lián)技術(shù)，具備高速系統(tǒng)調(diào)試能力
熟悉PyTorch/TensorRT等AI框架的硬件加速原理，有模型量化部署經(jīng)驗(yàn)更佳
技術(shù)極客特質(zhì)，在開源硬件社區(qū)（如RISC-V生態(tài)）有貢獻(xiàn)者優(yōu)先
強(qiáng)烈的創(chuàng)新意識與技術(shù)好奇心，能適應(yīng)快速迭代的技術(shù)攻關(guān)節(jié)奏