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職責(zé)描述： 1.根據(jù)需求完成FPGA的需求分析及方案論證； 2.獨(dú)立完成基于VHDL.Verilog的FPGA設(shè)計(jì) 3.負(fù)責(zé)FPGA程序的編寫.算法的設(shè)計(jì)仿真.FPGA調(diào)試； 4.負(fù)責(zé)FPGA的調(diào)試，分析并解決技術(shù)問題，完成核心技術(shù)攻關(guān)； 5.完成所負(fù)責(zé)產(chǎn)品的設(shè)計(jì)文檔和測試文檔的編寫。 任職要求： 1.電子、通信、自動(dòng)化等相關(guān)專業(yè)碩士以上學(xué)歷，有3年以上的FPGA開發(fā)經(jīng)驗(yàn)； 2.熟練掌握Verlog/VHDL語言，掌握Xilinx/Altera開發(fā)設(shè)計(jì)工具鏈； 3.熟練掌握FPGA設(shè)計(jì)，開發(fā)流程和仿真技術(shù)，具有獨(dú)立的FPGA編碼、仿真、調(diào)試能力； 4. 精通FPGA的高速接口設(shè)計(jì)，包括PCIE、DDR、ADC、DAC； 5. 具有良好的代碼風(fēng)格和文檔編寫習(xí)慣， 6. 能夠獨(dú)立運(yùn)用邏輯分析儀.示波器.數(shù)字萬用表等調(diào)試手段； 7. 具有良好的英文文檔閱讀能力； 福利待遇： 1、【社保公積金】入職即購買五險(xiǎn)一金。 2、【日常福利】公司免費(fèi)供應(yīng)各種下午茶零食；公司提倡高效工作，不強(qiáng)制加班。 3、【傳統(tǒng)節(jié)日福利】端午、中秋等傳統(tǒng)節(jié)日贈(zèng)送節(jié)日禮品。 4、【帶薪假期】雙休，入職滿一年的員工可享受5天的帶薪年假，同時(shí)享有國家規(guī)定其他帶薪假期（法定假日、婚假、產(chǎn)假、陪產(chǎn)假、喪假等）； 5、【發(fā)展平臺(tái)】提供豐厚的薪酬、項(xiàng)目獎(jiǎng)金及廣闊的個(gè)人發(fā)展空間，對于表現(xiàn)優(yōu)秀的員工將給予提前轉(zhuǎn)正、晉升、新項(xiàng)目等施展才華的空間。