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初級(jí)設(shè)計(jì)驗(yàn)證 (DV) 工程師
工資面議


工作職責(zé)：
1、 學(xué)習(xí)與理解：
a) 積極學(xué)習(xí)和理解設(shè)計(jì)規(guī)范、驗(yàn)證計(jì)劃和驗(yàn)證方法（尤其是 UVM），重點(diǎn)是學(xué)習(xí) SystemVerilog、UVM、腳本編寫和調(diào)試方面的基礎(chǔ)技能。
b) 熟悉待驗(yàn)證設(shè)計(jì) (DUV) 及其功能。

2、 測(cè)試環(huán)境貢獻(xiàn)：
a) 在指導(dǎo)下協(xié)助開發(fā)和修改現(xiàn)有的 UVM 測(cè)試平臺(tái)和驗(yàn)證組件（例如，序列、事務(wù)處理器、監(jiān)視器、記分板）。
b) 將簡單的驗(yàn)證 IP (VIP) 或通用驗(yàn)證組件 (UVC) 集成到測(cè)試環(huán)境中。

3、 測(cè)試用例開發(fā)與執(zhí)行：
a) 編寫并調(diào)試定向測(cè)試用例，以覆蓋特定的設(shè)計(jì)功能。
b) 運(yùn)行回歸測(cè)試，分析仿真日志并解讀波形。
c) 與高級(jí)工程師合作，理解并開發(fā)約束隨機(jī)測(cè)試用例。

4、 調(diào)試和根本原因分析（在指導(dǎo)下）：
a) 使用仿真工具和波形查看器調(diào)試測(cè)試失敗，以確定錯(cuò)誤的大致位置。
b) 與高級(jí)DV工程師和設(shè)計(jì)工程師緊密合作，了解并解決設(shè)計(jì)問題。

5、 覆蓋率分析（基礎(chǔ)）：
a) 理解代碼覆蓋率和功能覆蓋率的概念。
b) 在指導(dǎo)下運(yùn)行覆蓋率報(bào)告并協(xié)助識(shí)別基本的覆蓋率漏洞。

6、 腳本編寫和自動(dòng)化（基礎(chǔ)）：
a) 利用現(xiàn)有的自動(dòng)化腳本（例如，用于運(yùn)行仿真、分析日志）。
b) 在指導(dǎo)下，開發(fā)用于基本自動(dòng)化任務(wù)或數(shù)據(jù)解析的簡單腳本（Python、Perl 或 Tcl）。

7、 文檔與溝通：
a) 協(xié)助記錄測(cè)試用例、測(cè)試平臺(tái)組件和錯(cuò)誤報(bào)告。
b) 有效地向團(tuán)隊(duì)溝通進(jìn)度和問題。

工作要求：
1、 電氣工程、計(jì)算機(jī)工程、電子工程或相關(guān)領(lǐng)域的學(xué)士或碩士學(xué)位。

2、 語言：
a) 硬件描述語言 (HDL)：扎實(shí)的 SystemVerilog 基礎(chǔ)知識(shí)至關(guān)重要，包括數(shù)據(jù)類型、過程塊、面向?qū)ο笤O(shè)計(jì) (OOD) 概念以及基本的 UVM 組件。理解 Verilog 語法和概念。
b) 腳本語言：熟練掌握至少一種腳本語言，例如 Python、Perl 或 Tcl，用于自動(dòng)化、測(cè)試生成和數(shù)據(jù)處理。
c) 編程語言：具備基礎(chǔ) C/C++ 編程技能者優(yōu)先，尤其適用于開發(fā)測(cè)試用例或理解嵌入式軟件交互。

3、 驗(yàn)證方法：
a) 基本了解通用驗(yàn)證方法 (UVM) 概念（組件、階段、序列、事務(wù)、連接）。通過課程或項(xiàng)目獲得的實(shí)踐經(jīng)驗(yàn)將優(yōu)先考慮。
b) 熟悉使用 SystemVerilog 斷言 (SVA) 進(jìn)行基于斷言的驗(yàn)證 (ABV) 者優(yōu)先。


4、 數(shù)字設(shè)計(jì)概念：
a) 扎實(shí)理解基本數(shù)字設(shè)計(jì)原理、邏輯門、時(shí)序邏輯與組合邏輯、狀態(tài)機(jī)以及基本計(jì)算機(jī)架構(gòu)。
b) 熟悉 RTL（寄存器傳輸級(jí)）概念。

5、 工具：
a) 仿真工具：通過學(xué)術(shù)項(xiàng)目或?qū)嵙?xí)，掌握至少一種行業(yè)標(biāo)準(zhǔn) EDA 仿真工具（例如 Synopsys VCS、Cadence Incisive/Xcelium、Siemens Questa/ModelSim）的實(shí)際操作經(jīng)驗(yàn)。
b) 調(diào)試工具：熟悉用于調(diào)試的波形查看器。
c) 版本控制系統(tǒng)：具備 Git 或其他版本控制系統(tǒng)的基本使用經(jīng)驗(yàn)。

6、 操作系統(tǒng)：熟悉 Linux/Unix 命令行環(huán)境。

期望（加分項(xiàng)）技能和經(jīng)驗(yàn)：

1、 具備硬件設(shè)計(jì)或驗(yàn)證方面的實(shí)習(xí)或合作經(jīng)驗(yàn)。
2、 在學(xué)術(shù)項(xiàng)目中熟悉特定接口/協(xié)議（例如 AMBA APB/AHB/AXI、PCIe、USB、SPI、I2C）。
3、 熟悉 SystemC 建模。
4、 了解形式化驗(yàn)證概念。
5、 熟悉使用 FPGA 平臺(tái)進(jìn)行基本設(shè)計(jì)測(cè)試。
6、 了解低功耗設(shè)計(jì)概念。
7、 參與過涉及硬件設(shè)計(jì)、FPGA 編程或嵌入式系統(tǒng)的大學(xué)或個(gè)人項(xiàng)目。

基本要求：

1、 具備強(qiáng)大的分析和解決問題能力。
2、 渴望學(xué)習(xí)并適應(yīng)新技術(shù)和新方法。
3、 積極主動(dòng)，能夠在團(tuán)隊(duì)環(huán)境中高效工作。
4、 良好的書面和口頭溝通能力。
5、 能夠服從指示，并在適當(dāng)?shù)臅r(shí)候主動(dòng)參與。