職位描述
VHDLVerilog
崗位職責:
1. 負責軟件無線電核心算法在FPGA上的實現(xiàn)、移植以及高速接口整合調(diào)試等工作；
2. 負責邏輯方案設(shè)計文檔撰寫，參與設(shè)計評審與代碼評審；
3. 參與軟件無線電系統(tǒng)總體設(shè)計、總體方案詳設(shè)計，與軟件無線電算法工程師協(xié)作，負責整機邏輯調(diào)試工作；
任職要求:
1.本科及以上學歷，電子、計算機、通信、自動化類相關(guān)專業(yè)；
2.熟悉VHDL或Verilog硬件描述語言，熟悉FPGA設(shè)計相關(guān)的開發(fā)工具、開發(fā)流程，熟悉常見FPGA特性與常用核，具備時序與資源約束、分析、優(yōu)化；
3. 具備較強的定位、分析與解決邏輯問題的能力
1. 負責軟件無線電核心算法在FPGA上的實現(xiàn)、移植以及高速接口整合調(diào)試等工作；
2. 負責邏輯方案設(shè)計文檔撰寫，參與設(shè)計評審與代碼評審；
3. 參與軟件無線電系統(tǒng)總體設(shè)計、總體方案詳設(shè)計，與軟件無線電算法工程師協(xié)作，負責整機邏輯調(diào)試工作；
任職要求:
1.本科及以上學歷，電子、計算機、通信、自動化類相關(guān)專業(yè)；
2.熟悉VHDL或Verilog硬件描述語言，熟悉FPGA設(shè)計相關(guān)的開發(fā)工具、開發(fā)流程，熟悉常見FPGA特性與常用核，具備時序與資源約束、分析、優(yōu)化；
3. 具備較強的定位、分析與解決邏輯問題的能力
工作地點
成都金牛區(qū)國賓總部基地
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