職位描述
Verilog HDL
任職要求：
2024或2025屆應(yīng)屆畢業(yè)生
1、碩士及以上學歷，微電子學／計算機／電子工程／通信工程等相關(guān)專業(yè);
2、想要往IC驗證方向發(fā)展;
3、了解芯片及數(shù)字電路；
4、有 C / Verilog/System Verilog /FPGA設(shè)計項目經(jīng)驗的優(yōu)先；
2024或2025屆應(yīng)屆畢業(yè)生
1、碩士及以上學歷，微電子學／計算機／電子工程／通信工程等相關(guān)專業(yè);
2、想要往IC驗證方向發(fā)展;
3、了解芯片及數(shù)字電路；
4、有 C / Verilog/System Verilog /FPGA設(shè)計項目經(jīng)驗的優(yōu)先；
工作地點
雁塔區(qū)西安神州數(shù)碼科技園
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