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招聘數(shù)字后端PD
負(fù)責(zé)數(shù)字芯片從RTL到GDSII的物理實(shí)現(xiàn)，包括邏輯綜合、布局規(guī)劃（FloorPlan）、時(shí)鐘樹(shù)綜合（CTS）、布線(xiàn)優(yōu)化（Place & Route）、時(shí)序收斂（STA）、功耗分析（IR Drop/EM）、物理驗(yàn)證（DRC/LVS）等環(huán)節(jié)
協(xié)同前端設(shè)計(jì)團(tuán)隊(duì)完成時(shí)序約束（SDC）編寫(xiě)和功能驗(yàn)證，確保芯片性能、面積及功耗（PPA）達(dá)標(biāo)
有先進(jìn)工藝PD經(jīng)驗(yàn)優(yōu)先，對(duì)28nm及以下先進(jìn)工藝節(jié)點(diǎn)（如12nm、7nm等），優(yōu)化設(shè)計(jì)流程，解決信號(hào)完整性（SI）、電壓降（IR Drop）等復(fù)雜問(wèn)題
流程開(kāi)發(fā)與自動(dòng)化，開(kāi)發(fā)并維護(hù)Tcl/Perl/Python腳本，提升布局布線(xiàn)、數(shù)據(jù)提取、驗(yàn)證等環(huán)節(jié)的自動(dòng)化效率
參與芯片級(jí)集成設(shè)計(jì)，與DFT、模擬版圖團(tuán)隊(duì)協(xié)作完成整體版圖規(guī)劃及驗(yàn)證
主導(dǎo)或協(xié)助技術(shù)文檔編寫(xiě)，包括設(shè)計(jì)報(bào)告、驗(yàn)證規(guī)范及工藝反饋
教育背景：微電子、電子工程、計(jì)算機(jī)科學(xué)或相關(guān)專(zhuān)業(yè)碩士及以上學(xué)歷，優(yōu)秀者可放寬至本科
專(zhuān)業(yè)技能：熟悉數(shù)字后端全流程工具鏈（如Synopsys IC Compiler、Cadence Innovus、Calibre等），掌握時(shí)序分析工具PrimeTime，精通Tcl/Shell腳本編程，具備Perl/Python開(kāi)發(fā)能力者優(yōu)先，熟悉UPF低功耗設(shè)計(jì)流程及先進(jìn)工藝設(shè)計(jì)規(guī)則（如FinFET技術(shù)等）
經(jīng)驗(yàn)要求：3年以上數(shù)字后端設(shè)計(jì)經(jīng)驗(yàn)，至少參與過(guò)1次成功流片項(xiàng)目，熟悉芯片級(jí)集成及模塊級(jí)物理設(shè)計(jì)，具備復(fù)雜SoC設(shè)計(jì)經(jīng)驗(yàn)（如CPU/GPU/AI芯片）者優(yōu)先
軟性能力：具備優(yōu)秀的邏輯分析能力和抗壓能力，適應(yīng)高強(qiáng)度流片周期
良好的團(tuán)隊(duì)溝通與跨部門(mén)協(xié)作能力
加分項(xiàng)
1.熟悉DFT設(shè)計(jì)（如Scan Chain、MBIST）及測(cè)試方案制定
2.有高速信號(hào)通信芯片經(jīng)驗(yàn)